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Este tipo de tecnología: Resistor Transistor Logic es relativamente antigua y tiene una serie de
limitaciones.
Compuerta NOR (No O) RTL
Si se desea implementar una compuerta NOR con tecnología RTL (Resistor Transistor Logic) ,
el diagrama sería como se muestra en el siguiente gráfico.
En este caso cada entrada tiene una
resistencia de 470 ohmios y un transistor.
 Al final todos los colectores de los
transistores se conectan en punto común y comparten una sola resistencia de 640
ohmios.
Si se desea obtener una compuerta OR, se
colocaría a la salida de esta compuerta un inversor como el que se mostró en el
primer diagrama
Compuerta NAND (No Y)
RTL
La compuerta NAND con tecnología RTL se implementa con una resistencia y un transistor para cada una
de las entradas de esta compuerta como se muestra en la figura.
 En este caso (y tomando en cuenta que la tensión colector
– emisor de un transistor saturado es de aproximadamente 0.3 voltios), la
tensión de salida en nivel bajo sería de 0.6 voltios.
Hay que recordar que si este nivel de
tensión (0.6 voltios) va ha servir de entrada a otro circuito RTL, faltaría muy
poco para que esta señal ("0" lógico) haga conducir el transistor de entrada
(0.7 voltios en la unión base-emisor) de la siguiente compuerta,
interpretándose erróneamente esta entrada como un "1" lógico.
La situación anterior se presenta con una
compuerta de 2 entradas. Si se implementara una compuerta con 3 entradas, la
salida "0" lógico sería de 0.9 voltios y no se podría interpretar como nivel
bajo por la compuerta que sigue (problema, pues pondría en conducción el
transistor cuando no debería hacerlo).
Este es uno de los problemas con las
compuertas RTL y se hace más notorio con el aumento de la frecuencia de
operación.
Otra opción sería utilizar las compuertas NOR y NOT y el
teorema DeMorgan para implementar una compuerta AND y NAND
*
Enlaces relacionados
- Circuitos lógicos
- Compuerta AND
- Compuerta OR
- La familia de circuitos TTL
- Lógica con diodos
<< Compuerta NOT con RTL
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